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File:NOR gate layout.png

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NOR_gate_layout.png(600 × 433 像素,檔案大小:22 KB,MIME 類型:image/png


摘要

描述

Shows a CMOS implementation of a NOR gate.

Also used at http://www.sccs.swarthmore.edu/users/06/adem/engin/e77vlsi/lab3/
日期 2009年11月20日 (原始上傳日期)
來源 No machine-readable source provided. Own work assumed (based on copyright claims).
作者 No machine-readable author provided. Miquel puig assumed (based on copyright claims).

授權條款

Public domain 我,此作品的版權所有人,釋出此作品至公共領域。此授權條款在全世界均適用。
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目前2009年11月20日 (五) 12:41於 2009年11月20日 (五) 12:41 版本的縮圖600 × 433(22 KB)Miquel puig== Summary == Shows a CMOS implementation of a NOR gate. Also used at http://www.sccs.swarthmore.edu/users/06/adem/engin/e77vlsi/lab3/ == Licensing == {{PD-self|date=November 2007}} Category:Logic Category:Logic gates

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