訊號邊緣
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在電子學中,訊號邊緣(英語:signal edge),或稱訊號邊沿,是數位訊號在兩種邏輯準位(0或1)之間狀態的轉變。由於數位訊號準位由方波來表示,因此這種狀態的變化被稱為「邊緣」。
訊號的一個正緣(rising edge)是數位訊號從低準位向高準位的轉變。當接入的時脈訊號由低準位向高準位轉變時,正反器電路被觸發,而當接入的時脈訊號從高準位向低準位轉變時,這種轉變則被正反器電路忽略,那麼我們稱這個正反器電路為正緣觸發的(rising edge-triggered)。
與正緣對應的概念為負緣(falling edge),它是指數位訊號從高準位向低準位的轉變。當接入的時脈訊號由高準位向低準位轉變時,正反器電路被觸發,而當接入的時脈訊號從低準位向高準位轉變時,這種轉變則被正反器電路忽略,那麼我們稱這個觸發電路為負緣觸發的(falling edge-triggered)。
訊號邊緣可以被用來觸發時序控制,在時間脈衝正緣或負緣觸發的T正反器就是一個典型的例子,這類正反器並不是通常的準位敏感,而是訊號邊緣敏感。此外,在硬體描述語言中,使用Verilog自定義原語(user defined primitives)時,正緣、負緣分別以(01)、(10)表示,也可以用縮寫字母r、f表示。
參考文獻
- 鄧元慶、關宇、賈鵬、石會. 数字设计基础与应用. 北京: 清華大學出版社. ISBN 978-7-302-21406-9.
- Samir Palnitkar. Verilog HDL: A Guilde to Digital Design and Synthesis. 電子工業出版社. ISBN 7-121-00468-2.