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ARM Cortex-A53

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ARM Cortex-A53
产品化2012
设计团队安谋控股
字长/暂存器资料宽度32-bit, 64-bit
微架构ARMv8-A
核心数量1–4个
一级快取16-128 KiB (8-64 KiB I-cache with parity, 8-64 KiB D-cache) per core
二级快取128-2048 KiB
上代产品ARM Cortex-A7
继任产品ARM Cortex-A55

ARM Cortex-A53是最早实现ARMv8-A 64位指令集的两个微架构之一,由ARM控股的剑桥设计中心设计。Cortex-A53是一个双路解码的超标量处理器,能够双重发送一些指令。它于2012年10月30日发布,由ARM作为更强大的Cortex-A57英语Cortex-A57微架构的一个独立、更节能的替代方案,或在big.LITTLE配置中与更强大的微架构一起使用。[1]

参考文献

  1. ^ ARM Cortex-A53. [2021-11-22]. (原始内容存档于2022-02-02) (英语).